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000012859 041__ $$aspa
000012859 1001_ $$aPérez Sanz, Diego
000012859 24500 $$aDiseño de un ecualizador en tiempo continuo para aplicaciones en comunicaciones serie de alta velocidad
000012859 260__ $$aZaragoza$$bUniversidad de Zaragoza$$c2013
000012859 506__ $$aby-nc-sa$$bCreative Commons$$c3.0$$uhttp://creativecommons.org/licenses/by-nc-sa/3.0/
000012859 520__ $$aEn este proyecto se propone como objetivo principal el diseño e implementación de arquitecturas de ecualización en tiempo continuo para aplicaciones en comunicaciones serie de alta velocidad. Para ello se abordará un estudio teórico y revisión bibliográfica de soluciones de bajo coste para la transmisión de alta capacidad por fibra óptica. De los diferentes subsistemas que componen la arquitectura del receptor, este trabajo se centrará en el amplificador de transimpedancia y en el ecualizador necesario para aumentar el ancho de banda de los bloques anteriores, permitiendo la obtención de arquitecturas más eficaces del front-end analógico del receptor de fibra óptica, minimizando de esta manera los efectos que impactan seriamente sobre la sensibilidad y velocidad total del sistema. Se llevará a cabo la caracterización experimental del prototipo T2-GDE-2013. Para ello será necesario abordar en primer lugar una primera fase consistente en la unión de un fotodiodo S5973 de Hamamatsu con el prototipo del TIA en un encapsulado DIP. Posteriormente se llevará a cabo la caracterización experimental de este bloque. Estas actividades implican la familiarización con la instrumentación necesaria y el proceso específico de medida. Una vez determinada la respuesta del TIA se procederá al diseño de un ecualizador con elementos discretos. En dicho diseño se abordará en primer lugar la elección de una topología adecuada a las necesidades particulares del T2-GDE-2013. Una vez determinada la arquitectura se procederá a la selección de componentes prestando especial atención a los elementos activos. La caracterización del bloque propuesto se realizará en dos fases: 1) mediante simulación, haciendo uso de programas como Matlab u OrCAD y 2) experimentalmente, mediante el diseño y montaje de PCBs mediante Eagle o PCAD. La última fase del proyecto consistiría en estudiar la posible migración de la topología discreta, objeto del estudio anterior, a un proceso de integración monolítico, para su posible utilización en receptores multiestándar en las bandas de transmisión de hasta 10 Gbps.
000012859 521__ $$aMáster Universitario en Ingeniería Electrónica
000012859 540__ $$aDerechos regulados por licencia Creative Commons
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000012859 700__ $$aAldea Chagoyen, Concepción$$edir.
000012859 700__ $$aGarcía del Pozo Faldos, José María$$edir.
000012859 7102_ $$aUniversidad de Zaragoza$$bIngeniería Electrónica y Comunicaciones$$cElectrónica
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