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GDOC-2014-3029 |
Curso: 2014-2015
Universidad de Zaragoza,
Zaragoza
Titulación: Máster Universitario en Ingeniería Electrónica
Idioma: Español
Profesor(es): Artigas Maestre, José Ignacio ; Barragán Pérez, Luis Ángel
Resumen: La asignatura forma al alumno en la descripción con VHDL e implementación en FPGA de sistemas electrónicos de control digital de etapas de potencia. Se abordan tanto las técnicas básicas de generación de las señales de disparo de los dispositivos como la implementación en coma fija de un regulador lineal y su simulación en lazo cerrado. Finalmente, se contemplan ejemplos completos de aplicación.
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