000037145 001__ 37145 000037145 005__ 20160204081813.0 000037145 037__ $$aTAZ-PFC-2015-300 000037145 041__ $$aspa 000037145 1001_ $$aBenitez Lorente, Jesús 000037145 24500 $$aFast Data Transfer based on a USB3.0 Super Speed Device 000037145 260__ $$aZaragoza$$bUniversidad de Zaragoza$$c2015 000037145 506__ $$aby-nc-sa$$bCreative Commons$$c3.0$$uhttp://creativecommons.org/licenses/by-nc-sa/3.0/ 000037145 520__ $$aEl objetivo de este proyecto es comprobar si el chip FX3 del microcontrolador FX3 Super Speed Device puede realizar una transmision de datos sin errores, para poder realizar el depurado de las se~nales del monitor AVALON1. Estos datos seran generados a una tasa constante de 16 Mbps. Para comprobarlo se llevaran a cabo varios experimentos en los que se utilizara una FPGA como generador de se~nales, el microcontrolador FX3 Super Speed Device como interfaz entre la FPGA y el ordenador y un disco duro externo donde se guardaran los datos enviados desde la FPGA. En el primero de ellos se implementara un contador de 16 bits en la FPGA y se enviaran los datos al ordenador a traves de un USB 3.0 sin ningun tipo de control sobre el buer del DMA lo que producira una gran perdida de datos debido a que el buer sera sobreescrito antes de que de tiempo a mandar los datos al bloque USB. Aunque con este primer experimento no se consigan los objetivos propuestos servira de base al experimento numero dos ya que se aprendera a programar los diferentes modulos del FX3 Super Speed Device, se comprobara que todos los bloques funcionan correctamente y se desarrollaran los scripts de Matlab que serviran de punto de partida para el segundo experimento. En el segundo experimento se enviara desde una FPGA al ordenador a traves del FX3 Super Speed Device una se~nal en diente de sierra. Esta vez se inspeccionara el buer del DMA antes de escribir en el, esto se hara utilizando el ag DMA0 Ready que indicara si el buer esta preparado para recibir informacion y el ag DMA0 Watermark que avisara con la antelacion que quiera el usuario de que el buer se va a llenar, esto permitira enviar datos al ordenador sabiendo con certeza de que no se perderan datos en el camino debido al desbordamiento del buer DMA. Por ultimo analizando los datos se llegara a la conclusion de que el chip permite llevar a cabo la transmision con los requerimientos exigidos y se analizara la in uencia de la tasa de transmision sobre la tasa de error recogiendo muestras durante media hora a diferentes frecuencias de reloj. 000037145 521__ $$aIngeniero de Telecomunicación 000037145 540__ $$aDerechos regulados por licencia Creative Commons 000037145 700__ $$aWohlschlager, Markus$$edir. 000037145 7102_ $$aUniversidad de Zaragoza$$bIngeniería Electrónica y Comunicaciones$$cTecnología Electrónica 000037145 7202_ $$aUrriza Parroqué, Isidro$$eponente 000037145 8560_ $$f610982@celes.unizar.es 000037145 8564_ $$s2349744$$uhttps://zaguan.unizar.es/record/37145/files/TAZ-PFC-2015-300.pdf$$yMemoria (spa) 000037145 909CO $$ooai:zaguan.unizar.es:37145$$pproyectos-fin-carrera$$pdriver 000037145 950__ $$a 000037145 951__ $$adeposita:2016-01-15 000037145 980__ $$aTAZ$$bPFC$$cEINA